眾核處理器 — 原理、設計與優化

李兆麟、王明羽、魏少軍

眾核處理器 — 原理、設計與優化 預覽內頁
  • 出版商: 清華大學
  • 出版日期: 2021-02-01
  • 定價: $594
  • 售價: 8.5 折 $505
  • 語言: 簡體中文
  • 頁數: 150
  • 裝訂: 平裝
  • ISBN: 7302567468
  • ISBN-13: 9787302567462
  • 相關分類: Computer-architecture

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商品描述

本書著重介紹眾核處理器，重點關註架構優化、存儲優化、運算資源優化、通信優化以及能耗與溫度優化等方面的關鍵技術。 從計算、存儲、通信三方面介紹眾核處理器架構的設計與優化技術，基於存儲機制、存儲層次結構、共享和私有Cache以及片上網絡通信機制等多方面詳細介紹瓷片眾核處理器架構，並提供瓷片眾核處理器架構的優化方案。

作者簡介

李兆麟，清華大學長聘教授，從事異構多核/眾核處理器、智能處理器、並行編程等領域研究，主持“核高基”重大專項、重點研發計劃、自然科學基金等多個項目，在IEEE期刊與國際會議發表論文100多篇，出版教材2部。


王明羽，清華大學博士，中山大學助理教授，碩士生導師，從事多核/眾核處理器、人工智能等領域研究，主持中國博士後科學基金，參與“核高基”重大專項等多個項目，發表學術論文10餘篇。


魏少軍，清華大學長聘教授，中國電子學會會士，IEEE Fellow，國家集成電路產業發展諮詢委員會委員，“核高基”國家科技重大專項技術總師，中國半導體行業協會副理事長，集成電路設計分會理事長，從事超大規模集成電路設計方法學、數字系統高層次綜合、嵌入式系統、可重構計算芯片等領域研究，發表論文200多篇，出版專著5部。

目錄大綱

目錄

第1章緒論
1.1處理器發展概述
1.2眾核處理器簡介
1.3指令調度技術
1.4片上網絡通信技術
1.5能耗優化技術
1.6小結
參考文獻

第2章眾核處理器架構
2.1處理器架構概述
2.2瓷片眾核處理器架構
2.3存儲機制
2.3.1存儲層次結構
2.3.2共享Cache架構
2.3.3私有Cache架構
2.4互連網絡
2.4.1片上網絡通信機制
2.4.2片上網絡延時優化技術
2.5小結
參考文獻

第3章眾核處理器存儲優化
3.1存儲層次結構
3.2Cache優化技術
3.3存儲結構優化設計
3.3.1自適應共享Cache結構
3.3.2自適應私有Cache架構
3.4互連網絡與Cache協同設計
3.4.1片上網絡延時優化設計
3.4.2片上網絡與自適應Cache的協同設計
3.5小結
參考文獻

第4章處理器核運算資源優化
4.1流處理器
4.2流程序的核心映射和調度
4.3運算資源利用率優化技術
4.3.1同構多線程與核心聯合
4.3.2運算單元高利用率調度
4.4利用率感知的核心映射和調度技術
4.4.1眾核流處理架構建模
4.4.2核心映射與調度優化
4.5小結
參考文獻

第5章基於片上網絡的通信優化
5.1片上網絡混合策略
5.2片上網絡延時和能耗建模
5.3片上網絡延時優化技術
5.3.1虛擬電路交換片上網絡路由器
5.3.2混合虛擬電路路徑分配算法
5.4片上網絡眾核編譯框架協同設計
5.4.1眾核編譯框架總體設計
5.4.2可執行代碼編譯生成
5.5小結
參考文獻

第6章處理器能耗與溫度優化
6.1能耗與溫度優化原理
6.2處理核能耗與溫度建模
6.3處理核指令編譯
6.3.1漏電功耗優化調度
6.3.2溫度優化的負載均衡
6.4眾核任務調度優化技術
6.4.1多任務子圖劃分和子網分配
6.4.2啟發式子任務映射
6.5小結
參考文獻

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